问题描述
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我正在编写一个应用程序,以便使用SystemC库模拟硬件系统。
我的问题是处理“ 0”类型。
考虑一个简单的模块
SC_MODULE(MyModule) {
sc_in_clk clk;
sc_out<sc_logic> outsig;
void main_process();
SC_CTOR(MyModule) {
SC_METHOD(main_process);
sensitive << clk;
}
};
考虑执行过程:
void MyModule::main_process() {
this->outsig.write(SC_LOGIC_1);
}
好。
问题:outsig
始终是\'0\'
,并且从不更改其值。
我在仿真中写入了许多信号,但是仅在sc_out
端口中的sc_logic
值时才会出现此问题。
有谁能够帮助我?
解决方法
在构造函数中,将ѭ7放在ѭ8之前。